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[Testbench] Add Caravel testbench for and2_testbench
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tangxifan
parent
d6b435018c
commit
187364ebc3
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@ -0,0 +1,30 @@
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FIRMWARE_PATH = ../common
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GCC_PATH?=/research/ece/lnis/USERS/DARPA_ERI/tools/riscv32i/bin
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GCC_PREFIX?=riscv32-unknown-elf
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.SUFFIXES:
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PATTERN = and2_latch_test_caravel
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all: ${PATTERN:=.hex}
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hex: ${PATTERN:=.hex}
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%.elf: %.c $(FIRMWARE_PATH)/sections.lds $(FIRMWARE_PATH)/start.s
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${GCC_PATH}/${GCC_PREFIX}-gcc -march=rv32imc -mabi=ilp32 -Wl,-Bstatic,-T,$(FIRMWARE_PATH)/sections.lds,--strip-debug -ffreestanding -nostdlib -o $@ $(FIRMWARE_PATH)/start.s $<
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%.hex: %.elf
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${GCC_PATH}/${GCC_PREFIX}-objcopy -O verilog $< $@
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# to fix flash base address
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sed -i 's/@10000000/@00000000/g' $@
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%.bin: %.elf
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${GCC_PATH}/${GCC_PREFIX}-objcopy -O binary $< /dev/stdout | tail -c +1048577 > $@
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# ---- Clean ----
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clean:
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rm -f *.elf *.hex *.bin *.vvp *.vcd *.log
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.PHONY: clean hex all
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@ -0,0 +1,114 @@
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#include "../common/defs.h"
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/*
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* Scan-chain Test:
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* - Configures directions for control ports
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* +==========+===============+===========+
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* | GPIO | Functionality | Direction |
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* +==========+===============+===========+
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* | GPIO[0] | TEST_EN | input |
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* +----------+---------------+-----------+
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* | GPIO[1] | IO_ISOL_N | input |
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* +----------+---------------+-----------+
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||||||
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* | GPIO[2] | RESET | input |
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* +----------+---------------+-----------+
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* | GPIO[3] | PROG_RESET | input |
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* +----------+---------------+-----------+
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* | GPIO[11] | SC_TAIL | output |
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* +----------+---------------+-----------+
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* | GPIO[12] | CCFF_HEAD | input |
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* +----------+---------------+-----------+
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|
* | GPIO[25] | MODE_SWITCH) | input |
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|
* +----------+---------------+-----------+
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|
* | GPIO[26] | SC_HEAD | input |
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* +----------+---------------+-----------+
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|
* | GPIO[35] | CCFF_TAIL | output |
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* +----------+---------------+-----------+
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* | GPIO[36] | CLK | input |
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* +----------+---------------+-----------+
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* | GPIO[37] | PROG_CLK | input |
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* +----------+---------------+-----------+
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*
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* - Configure unused FPGA data I/Os to be input
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* - Configure used FPGA data I/Os
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*
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* +==========+===============+===========+
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* | GPIO | Functionality | Direction |
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* +==========+===============+===========+
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|
* | GPIO[24] | a | input |
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* +----------+---------------+-----------+
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* | GPIO[27] | b | input |
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|
* +----------+---------------+-----------+
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||||||
|
* | GPIO[28] | c | output |
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|
* +----------+---------------+-----------+
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|
* | GPIO[23] | d | output |
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|
* +----------+---------------+-----------+
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||||||
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*/
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|
void main() {
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/*
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IO Control Registers
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| DM | VTRIP | SLOW | AN_POL | AN_SEL | AN_EN | MOD_SEL | INP_DIS | HOLDH | OEB_N | MGMT_EN |
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| 3-bits | 1-bit | 1-bit | 1-bit | 1-bit | 1-bit | 1-bit | 1-bit | 1-bit | 1-bit | 1-bit |
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Output: 0000_0110_0000_1110 (0x1808) = GPIO_MODE_USER_STD_OUTPUT
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| DM | VTRIP | SLOW | AN_POL | AN_SEL | AN_EN | MOD_SEL | INP_DIS | HOLDH | OEB_N | MGMT_EN |
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| 110 | 0 | 0 | 0 | 0 | 0 | 0 | 1 | 0 | 0 | 0 |
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Input: 0000_0001_0000_1111 (0x0402) = GPIO_MODE_USER_STD_INPUT_NOPULL
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| DM | VTRIP | SLOW | AN_POL | AN_SEL | AN_EN | MOD_SEL | INP_DIS | HOLDH | OEB_N | MGMT_EN |
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||||||
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| 001 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 1 | 0 |
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|
*/
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// By default all the I/Os are in input mode
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reg_mprj_io_0 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_1 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_2 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_3 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_4 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_5 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_6 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_7 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_8 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_9 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_10 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_12 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_13 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
reg_mprj_io_14 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_15 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
reg_mprj_io_16 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_17 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_18 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
reg_mprj_io_19 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
reg_mprj_io_20 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_21 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_22 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
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reg_mprj_io_24 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
reg_mprj_io_25 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
reg_mprj_io_26 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_27 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_29 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_30 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_31 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_32 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_33 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
reg_mprj_io_34 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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||||||
|
reg_mprj_io_36 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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reg_mprj_io_37 = GPIO_MODE_USER_STD_INPUT_NOPULL;
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|
// Only specify those should be in output mode
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reg_mprj_io_11 = GPIO_MODE_USER_STD_OUTPUT;
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reg_mprj_io_35 = GPIO_MODE_USER_STD_OUTPUT;
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// Implementation outputs
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reg_mprj_io_23 = GPIO_MODE_USER_STD_OUTPUT;
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reg_mprj_io_28 = GPIO_MODE_USER_STD_OUTPUT;
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/* Apply configuration */
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reg_mprj_xfer = 1;
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while (reg_mprj_xfer == 1);
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}
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@ -0,0 +1,58 @@
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@00000000
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93 00 00 00 93 01 00 00 13 02 00 00 93 02 00 00
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13 03 00 00 93 03 00 00 13 04 00 00 93 04 00 00
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13 05 00 00 93 05 00 00 13 06 00 00 93 06 00 00
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13 07 00 00 93 07 00 00 13 08 00 00 93 08 00 00
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13 09 00 00 93 09 00 00 13 0A 00 00 93 0A 00 00
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13 0B 00 00 93 0B 00 00 13 0C 00 00 93 0C 00 00
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13 0D 00 00 93 0D 00 00 13 0E 00 00 93 0E 00 00
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13 0F 00 00 93 0F 00 00 17 05 00 00 13 05 45 31
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|
93 05 00 00 13 06 00 00 63 D8 C5 00 14 41 94 C1
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|
11 05 91 05 E3 CC C5 FE 13 05 00 00 93 05 00 00
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|
63 57 B5 00 23 20 05 00 11 05 E3 4D B5 FE 71 28
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|
01 A0 01 00 B7 02 00 28 13 03 00 12 23 90 62 00
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|
A3 81 02 00 05 C6 21 4F 93 73 F6 0F 93 DE 73 00
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|
23 80 D2 01 93 EE 0E 01 23 80 D2 01 86 03 93 F3
|
||||||
|
F3 0F 7D 1F E3 14 0F FE 23 80 62 00 A1 C9 13 0F
|
||||||
|
00 02 83 23 05 00 A1 4F 93 DE F3 01 23 80 D2 01
|
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|
93 EE 0E 01 23 80 D2 01 83 CE 02 00 93 FE 2E 00
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||||||
|
93 DE 1E 00 86 03 B3 E3 D3 01 7D 1F 63 17 0F 00
|
||||||
|
23 20 75 00 11 05 83 23 05 00 FD 1F E3 96 0F FC
|
||||||
|
FD 15 F1 F1 63 04 0F 00 23 20 75 00 13 03 00 08
|
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|
A3 81 62 00 82 80 01 00 00 00 41 11 22 C6 00 08
|
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|
B7 07 00 26 93 87 07 02 13 07 20 40 98 C3 B7 07
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00 26 93 87 47 02 13 07 20 40 98 C3 B7 07 00 26
|
||||||
|
93 87 87 02 13 07 20 40 98 C3 B7 07 00 26 93 87
|
||||||
|
C7 02 13 07 20 40 98 C3 B7 07 00 26 93 87 07 03
|
||||||
|
13 07 20 40 98 C3 B7 07 00 26 93 87 47 03 13 07
|
||||||
|
20 40 98 C3 B7 07 00 26 93 87 87 03 13 07 20 40
|
||||||
|
98 C3 B7 07 00 26 93 87 C7 03 13 07 20 40 98 C3
|
||||||
|
B7 07 00 26 93 87 07 04 13 07 20 40 98 C3 B7 07
|
||||||
|
00 26 93 87 47 04 13 07 20 40 98 C3 B7 07 00 26
|
||||||
|
93 87 87 04 13 07 20 40 98 C3 B7 07 00 26 93 87
|
||||||
|
07 05 13 07 20 40 98 C3 B7 07 00 26 93 87 47 05
|
||||||
|
13 07 20 40 98 C3 B7 07 00 26 93 87 87 05 13 07
|
||||||
|
20 40 98 C3 B7 07 00 26 93 87 C7 05 13 07 20 40
|
||||||
|
98 C3 B7 07 00 26 93 87 07 06 13 07 20 40 98 C3
|
||||||
|
B7 07 00 26 93 87 47 06 13 07 20 40 98 C3 B7 07
|
||||||
|
00 26 93 87 87 06 13 07 20 40 98 C3 B7 07 00 26
|
||||||
|
93 87 C7 06 13 07 20 40 98 C3 B7 07 00 26 93 87
|
||||||
|
07 07 13 07 20 40 98 C3 B7 07 00 26 93 87 47 07
|
||||||
|
13 07 20 40 98 C3 B7 07 00 26 93 87 87 07 13 07
|
||||||
|
20 40 98 C3 B7 07 00 26 93 87 07 08 13 07 20 40
|
||||||
|
98 C3 B7 07 00 26 93 87 47 08 13 07 20 40 98 C3
|
||||||
|
B7 07 00 26 93 87 87 08 13 07 20 40 98 C3 B7 07
|
||||||
|
00 26 93 87 C7 08 13 07 20 40 98 C3 B7 07 00 26
|
||||||
|
93 87 47 09 13 07 20 40 98 C3 B7 07 00 26 93 87
|
||||||
|
87 09 13 07 20 40 98 C3 B7 07 00 26 93 87 C7 09
|
||||||
|
13 07 20 40 98 C3 B7 07 00 26 93 87 07 0A 13 07
|
||||||
|
20 40 98 C3 B7 07 00 26 93 87 47 0A 13 07 20 40
|
||||||
|
98 C3 B7 07 00 26 93 87 87 0A 13 07 20 40 98 C3
|
||||||
|
B7 07 00 26 93 87 07 0B 13 07 20 40 98 C3 B7 07
|
||||||
|
00 26 93 87 47 0B 13 07 20 40 98 C3 B7 07 00 26
|
||||||
|
93 87 C7 04 09 67 13 07 87 80 98 C3 B7 07 00 26
|
||||||
|
93 87 C7 0A 09 67 13 07 87 80 98 C3 B7 07 00 26
|
||||||
|
93 87 C7 07 09 67 13 07 87 80 98 C3 B7 07 00 26
|
||||||
|
93 87 07 09 09 67 13 07 87 80 98 C3 B7 07 00 26
|
||||||
|
05 47 98 C3 01 00 B7 07 00 26 98 43 85 47 E3 0C
|
||||||
|
F7 FE 01 00 32 44 41 01 82 80 00 00
|
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