mirror of https://github.com/YosysHQ/yosys.git
Added RTLIL::Module::connections()
This commit is contained in:
parent
b03aec6e32
commit
7ac9dc7f6e
|
@ -883,6 +883,11 @@ void RTLIL::Module::connect(const RTLIL::SigSpec &lhs, const RTLIL::SigSpec &rhs
|
||||||
connections_.push_back(RTLIL::SigSig(lhs, rhs));
|
connections_.push_back(RTLIL::SigSig(lhs, rhs));
|
||||||
}
|
}
|
||||||
|
|
||||||
|
const std::vector<RTLIL::SigSig> &RTLIL::Module::connections()
|
||||||
|
{
|
||||||
|
return connections_;
|
||||||
|
}
|
||||||
|
|
||||||
void RTLIL::Module::fixup_ports()
|
void RTLIL::Module::fixup_ports()
|
||||||
{
|
{
|
||||||
std::vector<RTLIL::Wire*> all_ports;
|
std::vector<RTLIL::Wire*> all_ports;
|
||||||
|
|
|
@ -290,6 +290,7 @@ struct RTLIL::Module
|
||||||
|
|
||||||
void connect(const RTLIL::SigSig &conn);
|
void connect(const RTLIL::SigSig &conn);
|
||||||
void connect(const RTLIL::SigSpec &lhs, const RTLIL::SigSpec &rhs);
|
void connect(const RTLIL::SigSpec &lhs, const RTLIL::SigSpec &rhs);
|
||||||
|
const std::vector<RTLIL::SigSig> &connections();
|
||||||
void fixup_ports();
|
void fixup_ports();
|
||||||
|
|
||||||
template<typename T> void rewrite_sigspecs(T functor);
|
template<typename T> void rewrite_sigspecs(T functor);
|
||||||
|
|
Loading…
Reference in New Issue