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Updates to GP_RCOSC, new GP_DFF*I cells
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commit
1058660ac8
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@ -24,6 +24,32 @@ module GP_DFFR(input D, CLK, nRST, output reg Q);
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);
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endmodule
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module GP_DFFSI(input D, CLK, nSET, output reg nQ);
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parameter [0:0] INIT = 1'bx;
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GP_DFFSRI #(
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.INIT(INIT),
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.SRMODE(1'b1),
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) _TECHMAP_REPLACE_ (
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.D(D),
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.CLK(CLK),
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.nSR(nSET),
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.nQ(nQ)
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);
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endmodule
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module GP_DFFRI(input D, CLK, nRST, output reg nQ);
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parameter [0:0] INIT = 1'bx;
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||||
GP_DFFSRI #(
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||||
.INIT(INIT),
|
||||
.SRMODE(1'b0),
|
||||
) _TECHMAP_REPLACE_ (
|
||||
.D(D),
|
||||
.CLK(CLK),
|
||||
.nSR(nRST),
|
||||
.nQ(nQ)
|
||||
);
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endmodule
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module GP_OBUFT(input IN, input OE, output OUT);
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GP_IOBUF _TECHMAP_REPLACE_ (
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.IN(IN),
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@ -165,6 +165,14 @@ module GP_DFF(input D, CLK, output reg Q);
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end
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endmodule
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module GP_DFFI(input D, CLK, output reg nQ);
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parameter [0:0] INIT = 1'bx;
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initial nQ = INIT;
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always @(posedge CLK) begin
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nQ <= ~D;
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||||
end
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||||
endmodule
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||||
module GP_DFFR(input D, CLK, nRST, output reg Q);
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parameter [0:0] INIT = 1'bx;
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||||
initial Q = INIT;
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@ -176,6 +184,17 @@ module GP_DFFR(input D, CLK, nRST, output reg Q);
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end
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||||
endmodule
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||||
module GP_DFFRI(input D, CLK, nRST, output reg nQ);
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parameter [0:0] INIT = 1'bx;
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||||
initial nQ = INIT;
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||||
always @(posedge CLK, negedge nRST) begin
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||||
if (!nRST)
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nQ <= 1'b1;
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||||
else
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||||
nQ <= ~D;
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end
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||||
endmodule
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module GP_DFFS(input D, CLK, nSET, output reg Q);
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parameter [0:0] INIT = 1'bx;
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||||
initial Q = INIT;
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@ -187,6 +206,17 @@ module GP_DFFS(input D, CLK, nSET, output reg Q);
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|||
end
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||||
endmodule
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||||
module GP_DFFSI(input D, CLK, nSET, output reg nQ);
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parameter [0:0] INIT = 1'bx;
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initial nQ = INIT;
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always @(posedge CLK, negedge nSET) begin
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if (!nSET)
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||||
nQ <= 1'b0;
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||||
else
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||||
nQ <= ~D;
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||||
end
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||||
endmodule
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||||
module GP_DFFSR(input D, CLK, nSR, output reg Q);
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parameter [0:0] INIT = 1'bx;
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||||
parameter [0:0] SRMODE = 1'bx;
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||||
|
@ -199,6 +229,18 @@ module GP_DFFSR(input D, CLK, nSR, output reg Q);
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|||
end
|
||||
endmodule
|
||||
|
||||
module GP_DFFSRI(input D, CLK, nSR, output reg nQ);
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||||
parameter [0:0] INIT = 1'bx;
|
||||
parameter [0:0] SRMODE = 1'bx;
|
||||
initial nQ = INIT;
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||||
always @(posedge CLK, negedge nSR) begin
|
||||
if (!nSR)
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||||
nQ <= ~SRMODE;
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||||
else
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||||
nQ <= ~D;
|
||||
end
|
||||
endmodule
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||||
module GP_IBUF(input IN, output OUT);
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||||
assign OUT = IN;
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endmodule
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@ -275,15 +317,15 @@ module GP_POR(output reg RST_DONE);
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endmodule
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||||
module GP_RCOSC(input PWRDN, output reg CLKOUT_PREDIV, output reg CLKOUT_FABRIC);
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||||
module GP_RCOSC(input PWRDN, output reg CLKOUT_HARDIP, output reg CLKOUT_FABRIC);
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||||
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||||
parameter PWRDN_EN = 0;
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||||
parameter AUTO_PWRDN = 0;
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||||
parameter PRE_DIV = 1;
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||||
parameter HARDIP_DIV = 1;
|
||||
parameter FABRIC_DIV = 1;
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||||
parameter OSC_FREQ = "25k";
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||||
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||||
initial CLKOUT_PREDIV = 0;
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||||
initial CLKOUT_HARDIP = 0;
|
||||
initial CLKOUT_FABRIC = 0;
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|
||||
//output dividers not implemented for simulation
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||||
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@ -291,7 +333,7 @@ module GP_RCOSC(input PWRDN, output reg CLKOUT_PREDIV, output reg CLKOUT_FABRIC)
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|||
|
||||
always begin
|
||||
if(PWRDN) begin
|
||||
CLKOUT_PREDIV = 0;
|
||||
CLKOUT_HARDIP = 0;
|
||||
CLKOUT_FABRIC = 0;
|
||||
end
|
||||
else begin
|
||||
|
@ -306,21 +348,21 @@ module GP_RCOSC(input PWRDN, output reg CLKOUT_PREDIV, output reg CLKOUT_FABRIC)
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|||
#250;
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||||
end
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||||
|
||||
CLKOUT_PREDIV = ~CLKOUT_PREDIV;
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||||
CLKOUT_HARDIP = ~CLKOUT_HARDIP;
|
||||
CLKOUT_FABRIC = ~CLKOUT_FABRIC;
|
||||
end
|
||||
end
|
||||
|
||||
endmodule
|
||||
|
||||
module GP_RINGOSC(input PWRDN, output reg CLKOUT_PREDIV, output reg CLKOUT_FABRIC);
|
||||
module GP_RINGOSC(input PWRDN, output reg CLKOUT_HARDIP, output reg CLKOUT_FABRIC);
|
||||
|
||||
parameter PWRDN_EN = 0;
|
||||
parameter AUTO_PWRDN = 0;
|
||||
parameter PRE_DIV = 1;
|
||||
parameter HARDIP_DIV = 1;
|
||||
parameter FABRIC_DIV = 1;
|
||||
|
||||
initial CLKOUT_PREDIV = 0;
|
||||
initial CLKOUT_HARDIP = 0;
|
||||
initial CLKOUT_FABRIC = 0;
|
||||
|
||||
//output dividers not implemented for simulation
|
||||
|
@ -328,13 +370,13 @@ module GP_RINGOSC(input PWRDN, output reg CLKOUT_PREDIV, output reg CLKOUT_FABRI
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|||
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||||
always begin
|
||||
if(PWRDN) begin
|
||||
CLKOUT_PREDIV = 0;
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||||
CLKOUT_HARDIP = 0;
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||||
CLKOUT_FABRIC = 0;
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||||
end
|
||||
else begin
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||||
//half period of 27 MHz
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#18.518;
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CLKOUT_PREDIV = ~CLKOUT_PREDIV;
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||||
CLKOUT_HARDIP = ~CLKOUT_HARDIP;
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||||
CLKOUT_FABRIC = ~CLKOUT_FABRIC;
|
||||
end
|
||||
end
|
||||
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