# Generated by Yosys 0.41+101 (git sha1 83a8e5de4, g++ 13.2.0 -fPIC -Os)
autoidx 1
module \gold
  wire width 7 input 1 \A
  wire width 3 input 2 \B
  wire width 4 output 3 \Y
  cell $gt \UUT
    parameter \A_SIGNED 1
    parameter \A_WIDTH 7
    parameter \B_SIGNED 1
    parameter \B_WIDTH 3
    parameter \Y_WIDTH 4
    connect \A \A
    connect \B \B
    connect \Y \Y
  end
end