mirror of https://github.com/YosysHQ/yosys.git
Remove ice40/cells_sim.v hack to avoid warning for blocking memory writes
Signed-off-by: Clifford Wolf <clifford@clifford.at>
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parent
d25a0c8ade
commit
9284cf92b8
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@ -414,24 +414,6 @@ module SB_RAM40_4K (
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$readmemh(INIT_FILE, memory);
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$readmemh(INIT_FILE, memory);
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else
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else
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for (i=0; i<16; i=i+1) begin
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for (i=0; i<16; i=i+1) begin
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`ifdef YOSYS
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memory[ 0*16 + i] <= INIT_0[16*i +: 16];
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memory[ 1*16 + i] <= INIT_1[16*i +: 16];
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memory[ 2*16 + i] <= INIT_2[16*i +: 16];
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memory[ 3*16 + i] <= INIT_3[16*i +: 16];
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memory[ 4*16 + i] <= INIT_4[16*i +: 16];
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||||||
memory[ 5*16 + i] <= INIT_5[16*i +: 16];
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||||||
memory[ 6*16 + i] <= INIT_6[16*i +: 16];
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||||||
memory[ 7*16 + i] <= INIT_7[16*i +: 16];
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||||||
memory[ 8*16 + i] <= INIT_8[16*i +: 16];
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memory[ 9*16 + i] <= INIT_9[16*i +: 16];
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memory[10*16 + i] <= INIT_A[16*i +: 16];
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memory[11*16 + i] <= INIT_B[16*i +: 16];
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memory[12*16 + i] <= INIT_C[16*i +: 16];
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memory[13*16 + i] <= INIT_D[16*i +: 16];
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memory[14*16 + i] <= INIT_E[16*i +: 16];
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memory[15*16 + i] <= INIT_F[16*i +: 16];
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||||||
`else
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memory[ 0*16 + i] = INIT_0[16*i +: 16];
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memory[ 0*16 + i] = INIT_0[16*i +: 16];
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memory[ 1*16 + i] = INIT_1[16*i +: 16];
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memory[ 1*16 + i] = INIT_1[16*i +: 16];
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memory[ 2*16 + i] = INIT_2[16*i +: 16];
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memory[ 2*16 + i] = INIT_2[16*i +: 16];
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@ -448,7 +430,6 @@ module SB_RAM40_4K (
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memory[13*16 + i] = INIT_D[16*i +: 16];
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memory[13*16 + i] = INIT_D[16*i +: 16];
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||||||
memory[14*16 + i] = INIT_E[16*i +: 16];
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memory[14*16 + i] = INIT_E[16*i +: 16];
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||||||
memory[15*16 + i] = INIT_F[16*i +: 16];
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memory[15*16 + i] = INIT_F[16*i +: 16];
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`endif
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end
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end
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end
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end
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