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Skip blackbox modules in design->selected_modules()
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8514fe79db
commit
5b41470e15
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@ -460,7 +460,7 @@ std::vector<RTLIL::Module*> RTLIL::Design::selected_modules() const
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std::vector<RTLIL::Module*> result;
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std::vector<RTLIL::Module*> result;
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result.reserve(modules_.size());
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result.reserve(modules_.size());
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for (auto &it : modules_)
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for (auto &it : modules_)
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if (selected_module(it.first))
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if (selected_module(it.first) && !it.second->get_bool_attribute("\\blackbox"))
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result.push_back(it.second);
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result.push_back(it.second);
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return result;
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return result;
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}
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}
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@ -470,7 +470,7 @@ std::vector<RTLIL::Module*> RTLIL::Design::selected_whole_modules() const
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std::vector<RTLIL::Module*> result;
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std::vector<RTLIL::Module*> result;
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result.reserve(modules_.size());
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result.reserve(modules_.size());
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||||||
for (auto &it : modules_)
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for (auto &it : modules_)
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||||||
if (selected_whole_module(it.first))
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if (selected_whole_module(it.first) && !it.second->get_bool_attribute("\\blackbox"))
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||||||
result.push_back(it.second);
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result.push_back(it.second);
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return result;
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return result;
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}
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}
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@ -480,7 +480,9 @@ std::vector<RTLIL::Module*> RTLIL::Design::selected_whole_modules_warn() const
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std::vector<RTLIL::Module*> result;
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std::vector<RTLIL::Module*> result;
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result.reserve(modules_.size());
|
result.reserve(modules_.size());
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||||||
for (auto &it : modules_)
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for (auto &it : modules_)
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if (selected_whole_module(it.first))
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if (it.second->get_bool_attribute("\\blackbox"))
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continue;
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else if (selected_whole_module(it.first))
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result.push_back(it.second);
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result.push_back(it.second);
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else if (selected_module(it.first))
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else if (selected_module(it.first))
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log_warning("Ignoring partially selected module %s.\n", log_id(it.first));
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log_warning("Ignoring partially selected module %s.\n", log_id(it.first));
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