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Merge branch 'master' of github.com:cliffordwolf/yosys
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commit
494a6f7949
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@ -881,3 +881,106 @@ module SB_WARMBOOT (
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input S0
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input S0
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);
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);
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endmodule
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endmodule
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// UltraPlus feature cells
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(* blackbox *)
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module SB_MAC16 (
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input CLK,
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input CE,
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input [15:0] C,
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input [15:0] A,
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input [15:0] B,
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input [15:0] D,
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input AHOLD,
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input BHOLD,
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input CHOLD,
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input DHOLD,
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input IRSTTOP,
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input IRSTBOT,
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input ORSTTOP,
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input ORSTBOT,
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input OLOADTOP,
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input OLOADBOT,
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input ADDSUBTOP,
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input ADDSUBBOT,
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input OHOLDTOP,
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input OHOLDBOT,
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input CI,
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input ACCUMCI,
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input SIGNEXTIN,
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output [31:0] O,
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output CO,
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output ACCUMCO,
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output SIGNEXTOUT
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);
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parameter NEG_TRIGGER = 1'b0;
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parameter C_REG = 1'b0;
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parameter A_REG = 1'b0;
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parameter B_REG = 1'b0;
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parameter D_REG = 1'b0;
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parameter TOP_8x8_MULT_REG = 1'b0;
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parameter BOT_8x8_MULT_REG = 1'b0;
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parameter PIPELINE_16x16_MULT_REG1 = 1'b0;
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parameter PIPELINE_16x16_MULT_REG2 = 1'b0;
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parameter TOPOUTPUT_SELECT = 2'b00;
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parameter TOPADDSUB_LOWERINPUT = 2'b00;
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parameter TOPADDSUB_UPPERINPUT = 1'b0;
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parameter TOPADDSUB_CARRYSELECT = 2'b00;
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parameter BOTOUTPUT_SELECT = 2'b00;
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parameter BOTADDSUB_LOWERINPUT = 2'b00;
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|
parameter BOTADDSUB_UPPERINPUT = 1'b0;
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parameter BOTADDSUB_CARRYSELECT = 2'b00;
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|
parameter MODE_8x8 = 1'b0;
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parameter A_SIGNED = 1'b0;
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parameter B_SIGNED = 1'b0;
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endmodule
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(* blackbox *)
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module SB_SPRAM256KA(
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input [13:0] ADDRESS,
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input [15:0] DATAIN,
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input [3:0] MASKWREN,
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input WREN,
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input CHIPSELECT,
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input CLOCK,
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input STANDBY,
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input SLEEP,
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input POWEROFF,
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output [15:0] DATAOUT
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);
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endmodule
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(* blackbox *)
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module SB_HFOSC(
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input CLKHFPU,
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input CLKHFEN,
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output CLKHF
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);
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parameter CLKHF_DIV = "0b00";
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endmodule
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(* blackbox *)
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module SB_LFOSC(
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input CLKLFPU,
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input CLKLFEN,
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output CLKLF
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);
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endmodule
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(* blackbox *)
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module SB_RGBA_DRV(
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input CURREN,
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input RGBLEDEN,
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input RGB0PWM,
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input RGB1PWM,
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input RGB2PWM,
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output RGB0,
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output RGB1,
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output RGB2
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);
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parameter CURRENT_MODE = "0b0";
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parameter RGB0_CURRENT = "0b000000";
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parameter RGB1_CURRENT = "0b000000";
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parameter RGB2_CURRENT = "0b000000";
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endmodule
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