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Signed-off-by: Clifford Wolf <clifford@clifford.at>
This commit is contained in:
parent
8b0719d1e3
commit
350dfd3745
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@ -1,3 +1,27 @@
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// https://coredocs.s3.amazonaws.com/Libero/12_0_0/Tool/sf2_mlg.pdf
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module ADD2 (
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input A, B,
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output Y
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);
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assign Y = A & B;
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endmodule
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module ADD3 (
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input A, B, C,
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output Y
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);
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assign Y = A & B & C;
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endmodule
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module ADD4 (
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input A, B, C, D,
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output Y
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);
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assign Y = A & B & C & D;
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endmodule
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module CFG1 (
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module CFG1 (
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output Y,
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output Y,
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input A
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input A
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@ -36,27 +60,6 @@ module CFG4 (
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assign Y = INIT >> {D, C, B, A};
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assign Y = INIT >> {D, C, B, A};
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endmodule
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endmodule
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module ADD2 (
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input A, B,
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output Y
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);
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assign Y = A & B;
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endmodule
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module ADD3 (
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input A, B, C,
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output Y
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);
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assign Y = A & B & C;
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endmodule
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module ADD4 (
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input A, B, C, D,
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output Y
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);
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assign Y = A & B & C & D;
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endmodule
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module BUFF (
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module BUFF (
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input A,
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input A,
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output Y
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output Y
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