mirror of https://github.com/efabless/caravel.git
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C
#include <defs.h>
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#include <stub.c>
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#include "bitbang_functions.c"
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void main(){
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unsigned int i, j, k;
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reg_wb_enable =1; // for enable writing to reg_debug_1 and reg_debug_2
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reg_debug_1 = 0x0;
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reg_debug_2 = 0x0;
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reg_mprj_io_37 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_36 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_35 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_34 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_33 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_32 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_31 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_30 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_29 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_28 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_27 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_26 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_25 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_24 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_23 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_22 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_21 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_20 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_19 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_18 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_17 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_16 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_15 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_14 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_13 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_12 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_11 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_10 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_9 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_8 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_7 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_6 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_5 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_4 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_3 = 0x1803 ;
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reg_mprj_io_2 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_1 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_0 = GPIO_MODE_MGMT_STD_OUTPUT;
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reg_mprj_io_0 = GPIO_MODE_MGMT_STD_OUTPUT;
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// bitbang
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// Configure all as output except reg_mprj_io_3
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clock_in_right_o_left_o_standard(0); // 18 and 19
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clock_in_right_o_left_o_standard(0); // 17 and 20
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clock_in_right_o_left_o_standard(0); // 16 and 21
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clock_in_right_o_left_o_standard(0); // 15 and 22
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clock_in_right_o_left_o_standard(0); // 14 and 23
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clock_in_right_o_left_o_standard(0); // 13 and 24
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clock_in_right_o_left_o_standard(0); // 12 and 25
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clock_in_right_o_left_o_standard(0); // 11 and 26
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clock_in_right_o_left_o_standard(0); // 10 and 27
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clock_in_right_o_left_o_standard(0); // 9 and 28
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clock_in_right_o_left_o_standard(0); // 8 and 29
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clock_in_right_o_left_o_standard(0); // 7 and 30
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clock_in_right_o_left_o_standard(0); // 6 and 31
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clock_in_right_o_left_o_standard(0); // 5 and 32
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clock_in_right_o_left_o_standard(0); // 4 and 33
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clock_in_right_o_left_i_standard(0); // 3 and 34
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clock_in_right_o_left_o_standard(0); // 2 and 35
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clock_in_right_o_left_o_standard(0); // 1 and 36
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clock_in_right_o_left_o_standard(0); // 0 and 37
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load();
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reg_debug_1 = 0xFF; // finish configuration
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reg_mprj_datal = 0x0;
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reg_mprj_datah = 0x0;
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i = 0x20;
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for (j = 0; j < 5; j++) {
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reg_mprj_datah = i;
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reg_debug_2 = 37-j;
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reg_mprj_datah = 0x00000000;
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|
reg_debug_2 = 0;
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i >>=1;
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i |= 0x20;
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}
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i = 0x80000000;
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for (j = 0; j < 32; j++) {
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reg_mprj_datah = 0x3f;
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|
reg_mprj_datal = i;
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|
reg_debug_2 = 32-j;
|
|
reg_mprj_datah = 0x00;
|
|
reg_mprj_datal = 0x00000000;
|
|
reg_debug_2 = 0;
|
|
i >>=1;
|
|
i |= 0x80000000;
|
|
}
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|
}
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