/* Generated by Yosys 0.9+4052 (git sha1 d061b0e, gcc 8.3.1 -fPIC -Os) */ module caravel(vddio, vddio_2, vssio, vssio_2, vdda, vssa, vccd, vssd, vdda1, vdda1_2, vdda2, vssa1, vssa1_2, vssa2, vccd1, vccd2, vssd1, vssd2, gpio, mprj_io, clock, resetb, flash_csb, flash_clk, flash_io0, flash_io1); wire caravel_clk; wire caravel_clk2; wire caravel_clk_buf; wire caravel_rstn; wire caravel_rstn_buf; wire clk_passthru; input clock; wire clock_core; wire clock_core_buf; wire debug_in; wire debug_mode; wire debug_oeb; wire debug_out; wire ext_clk_sel; wire ext_reset; output flash_clk; wire flash_clk_core; wire flash_clk_frame; wire flash_clk_frame_buf; wire flash_clk_ieb; wire flash_clk_ieb_buf; wire flash_clk_oeb; wire flash_clk_oeb_buf; wire flash_clk_oeb_core; output flash_csb; wire flash_csb_core; wire flash_csb_frame; wire flash_csb_frame_buf; wire flash_csb_ieb; wire flash_csb_ieb_buf; wire flash_csb_oeb; wire flash_csb_oeb_buf; wire flash_csb_oeb_core; output flash_io0; wire flash_io0_di; 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