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update caravel top-level rtl to add `buff_flash_clkrst` module
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f4f26398f0
commit
c3a2c8650e
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@ -215,7 +215,58 @@ module caravel (
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wire flash_io0_do, flash_io1_do;
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wire flash_io0_do, flash_io1_do;
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||||||
wire flash_io0_di, flash_io1_di;
|
wire flash_io0_di, flash_io1_di;
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||||||
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chip_io padframe(
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// Flash buffered signals
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wire flash_clk_frame_buf;
|
||||||
|
wire flash_csb_frame_buf;
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||||||
|
wire flash_clk_ieb_buf, flash_csb_ieb_buf;
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||||||
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wire flash_io0_oeb_buf, flash_io1_oeb_buf;
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||||||
|
wire flash_io0_ieb_buf, flash_io1_ieb_buf;
|
||||||
|
wire flash_io0_do_buf, flash_io1_do_buf;
|
||||||
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wire flash_io0_di_buf, flash_io1_di_buf;
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||||||
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||||||
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// Clock and reset buffered signals
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wire caravel_clk_buf;
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|
wire caravel_rstn_buf;
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|
wire clock_core_buf;
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buff_flash_clkrst flash_clkrst_buffers (
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.in_n({
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caravel_clk,
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|
caravel_rstn,
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||||||
|
flash_clk_frame,
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||||||
|
flash_csb_frame,
|
||||||
|
flash_clk_oeb,
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||||||
|
flash_csb_oeb,
|
||||||
|
flash_io0_oeb,
|
||||||
|
flash_io1_oeb,
|
||||||
|
flash_io0_ieb,
|
||||||
|
flash_io1_ieb,
|
||||||
|
flash_io0_do,
|
||||||
|
flash_io1_do }),
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||||||
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.in_s({
|
||||||
|
clock_core,
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||||||
|
flash_io1_di,
|
||||||
|
flash_io0_di }),
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||||||
|
.out_s({
|
||||||
|
caravel_clk_buf,
|
||||||
|
caravel_rstn_buf,
|
||||||
|
flash_clk_frame_buf,
|
||||||
|
flash_csb_frame_buf,
|
||||||
|
flash_clk_oeb_buf,
|
||||||
|
flash_csb_oeb_buf,
|
||||||
|
flash_io0_oeb_buf,
|
||||||
|
flash_io1_oeb_buf,
|
||||||
|
flash_io0_ieb_buf,
|
||||||
|
flash_io1_ieb_buf,
|
||||||
|
flash_io0_do_buf,
|
||||||
|
flash_io1_do_buf }),
|
||||||
|
.out_n({
|
||||||
|
clock_core_buf,
|
||||||
|
flash_io1_di_buf,
|
||||||
|
flash_io0_di_buf })
|
||||||
|
);
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||||||
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||||||
|
chip_io padframe(
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||||||
`ifndef TOP_ROUTING
|
`ifndef TOP_ROUTING
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||||||
// Package Pins
|
// Package Pins
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||||||
.vddio_pad (vddio), // Common padframe/ESD supply
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.vddio_pad (vddio), // Common padframe/ESD supply
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||||||
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@ -271,16 +322,16 @@ module caravel (
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||||||
.gpio_mode1_core(gpio_mode1_core),
|
.gpio_mode1_core(gpio_mode1_core),
|
||||||
.gpio_outenb_core(gpio_outenb_core),
|
.gpio_outenb_core(gpio_outenb_core),
|
||||||
.gpio_inenb_core(gpio_inenb_core),
|
.gpio_inenb_core(gpio_inenb_core),
|
||||||
.flash_csb_core(flash_csb_frame),
|
.flash_csb_core(flash_csb_frame_buf),
|
||||||
.flash_clk_core(flash_clk_frame),
|
.flash_clk_core(flash_clk_frame_buf),
|
||||||
.flash_csb_oeb_core(flash_csb_oeb),
|
.flash_csb_oeb_core(flash_csb_oeb_buf),
|
||||||
.flash_clk_oeb_core(flash_clk_oeb),
|
.flash_clk_oeb_core(flash_clk_oeb_buf),
|
||||||
.flash_io0_oeb_core(flash_io0_oeb),
|
.flash_io0_oeb_core(flash_io0_oeb_buf),
|
||||||
.flash_io1_oeb_core(flash_io1_oeb),
|
.flash_io1_oeb_core(flash_io1_oeb_buf),
|
||||||
.flash_io0_ieb_core(flash_io0_ieb),
|
.flash_io0_ieb_core(flash_io0_ieb_buf),
|
||||||
.flash_io1_ieb_core(flash_io1_ieb),
|
.flash_io1_ieb_core(flash_io1_ieb_buf),
|
||||||
.flash_io0_do_core(flash_io0_do),
|
.flash_io0_do_core(flash_io0_do_buf),
|
||||||
.flash_io1_do_core(flash_io1_do),
|
.flash_io1_do_core(flash_io1_do_buf),
|
||||||
.flash_io0_di_core(flash_io0_di),
|
.flash_io0_di_core(flash_io0_di),
|
||||||
.flash_io1_di_core(flash_io1_di),
|
.flash_io1_di_core(flash_io1_di),
|
||||||
.mprj_io_one(mprj_io_one),
|
.mprj_io_one(mprj_io_one),
|
||||||
|
@ -379,12 +430,12 @@ module caravel (
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`endif
|
`endif
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||||||
|
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||||||
// Clock and reset
|
// Clock and reset
|
||||||
.core_clk(caravel_clk),
|
.core_clk(caravel_clk_buf),
|
||||||
.core_rstn(caravel_rstn),
|
.core_rstn(caravel_rstn_buf),
|
||||||
|
|
||||||
// Pass thru Clock and reset
|
// Pass thru Clock and reset
|
||||||
.clk_in(caravel_clk),
|
.clk_in(caravel_clk_buf),
|
||||||
.resetn_in(caravel_rstn),
|
.resetn_in(caravel_rstn_buf),
|
||||||
.clk_out(clk_passthru),
|
.clk_out(clk_passthru),
|
||||||
.resetn_out(resetn_passthru),
|
.resetn_out(resetn_passthru),
|
||||||
|
|
||||||
|
@ -629,7 +680,7 @@ module caravel (
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||||||
.VGND(vssd_core),
|
.VGND(vssd_core),
|
||||||
`endif
|
`endif
|
||||||
.ext_clk_sel(ext_clk_sel),
|
.ext_clk_sel(ext_clk_sel),
|
||||||
.ext_clk(clock_core),
|
.ext_clk(clock_core_buf),
|
||||||
.pll_clk(pll_clk),
|
.pll_clk(pll_clk),
|
||||||
.pll_clk90(pll_clk90),
|
.pll_clk90(pll_clk90),
|
||||||
.resetb(rstb_l),
|
.resetb(rstb_l),
|
||||||
|
@ -650,7 +701,7 @@ module caravel (
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||||||
`endif
|
`endif
|
||||||
.resetb(rstb_l),
|
.resetb(rstb_l),
|
||||||
.enable(spi_pll_ena),
|
.enable(spi_pll_ena),
|
||||||
.osc(clock_core),
|
.osc(clock_core_buf),
|
||||||
.clockp({pll_clk, pll_clk90}),
|
.clockp({pll_clk, pll_clk90}),
|
||||||
.div(spi_pll_div),
|
.div(spi_pll_div),
|
||||||
.dco(spi_pll_dco_ena),
|
.dco(spi_pll_dco_ena),
|
||||||
|
@ -751,8 +802,8 @@ module caravel (
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||||||
.pad_flash_io1_ieb(flash_io1_ieb),
|
.pad_flash_io1_ieb(flash_io1_ieb),
|
||||||
.pad_flash_io0_do(flash_io0_do),
|
.pad_flash_io0_do(flash_io0_do),
|
||||||
.pad_flash_io1_do(flash_io1_do),
|
.pad_flash_io1_do(flash_io1_do),
|
||||||
.pad_flash_io0_di(flash_io0_di),
|
.pad_flash_io0_di(flash_io0_di_buf),
|
||||||
.pad_flash_io1_di(flash_io1_di),
|
.pad_flash_io1_di(flash_io1_di_buf),
|
||||||
|
|
||||||
`ifdef USE_SRAM_RO_INTERFACE
|
`ifdef USE_SRAM_RO_INTERFACE
|
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.sram_ro_clk(hkspi_sram_clk),
|
.sram_ro_clk(hkspi_sram_clk),
|
||||||
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