OpenFPGA/libs/libnamemanager/example/example_module_names.xml

6 lines
206 B
XML

<module_names>
<module_name default="tile_0__1_" given="tile_io_bottom"/>
<module_name default="tile_1__1_" given="tile_clb"/>
<module_name default="tile_1__0_" given="tile_io_left"/>
</module_names>