diff --git a/openfpga/src/repack/check_lb_rr_graph.cpp b/openfpga/src/repack/check_lb_rr_graph.cpp
index 9b3adbf8f..64b286b62 100644
--- a/openfpga/src/repack/check_lb_rr_graph.cpp
+++ b/openfpga/src/repack/check_lb_rr_graph.cpp
@@ -79,8 +79,8 @@ static bool check_lb_rr_graph_dangling_nodes(const LbRRGraph& lb_rr_graph) {
if ((0 == lb_rr_graph.node_in_edges(node).size())
&& (0 == lb_rr_graph.node_out_edges(node).size())) {
/* Print a warning! */
- VTR_LOG_WARN("Node %s is dangling (zero fan-in and zero fan-out)!\n",
- node);
+ VTR_LOG_WARN("Node %lu is dangling (zero fan-in and zero fan-out)!\n",
+ size_t(node));
VTR_LOG_WARN("Node details for debugging:\n");
print_lb_rr_node(lb_rr_graph, node);
no_dangling = false;
diff --git a/openfpga/test_openfpga_arch/k6_frac_N10_adder_register_chain_40nm_openfpga.xml b/openfpga/test_openfpga_arch/k6_frac_N10_adder_register_chain_40nm_openfpga.xml
new file mode 100644
index 000000000..81a9582dc
--- /dev/null
+++ b/openfpga/test_openfpga_arch/k6_frac_N10_adder_register_chain_40nm_openfpga.xml
@@ -0,0 +1,288 @@
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+ 10e-12
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+ 10e-12
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+ 10e-12
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+ 10e-12 5e-12
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+ 10e-12 5e-12
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+ 10e-12 5e-12 5e-12
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+ 10e-12 5e-12 5e-12
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diff --git a/openfpga/test_vpr_arch/k6_frac_N10_tileable_adder_register_chain_40nm.xml b/openfpga/test_vpr_arch/k6_frac_N10_tileable_adder_register_chain_40nm.xml
new file mode 100644
index 000000000..77dedbcb0
--- /dev/null
+++ b/openfpga/test_vpr_arch/k6_frac_N10_tileable_adder_register_chain_40nm.xml
@@ -0,0 +1,696 @@
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+ io.outpad io.inpad
+ io.outpad io.inpad
+ io.outpad io.inpad
+ io.outpad io.inpad
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+ clb.clk
+ clb.cin clb.regin
+ clb.O[9:0] clb.I[19:0]
+ clb.cout clb.regout clb.O[19:10] clb.I[39:20]
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+ 235e-12
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+ 195e-12
+ 195e-12
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+ 261e-12
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